Designing with the Xilinx 7 Series Families
Full Course Outline
1
7 Series FPGA Overview
CLB Architecture
Slice Flip-Flops
Lab 1: CLB Resources
Memory Resources
Lab 2: Memory Resources
DSP Resources
Lab 3: DSP Resources
2
I/O Resources
Lab 4: I/O Resources
Clocking Resources
Lab 5: Clocking Resources
Memory Controllers
Dedicated Hardware
Coding Techniques
使用6系列FPGA产品进行设计培训之
利用 Spartan-6 和 Virtex-6 系列进行设计培训
课程概要
1
Spartan-6 FPGA 简介
Virtex-6 FPGA 简介
CLB 架构
HDL 编码技术
实验1：CLB 资源
存储器资源
DSP 资源
2
实验2：DSP 资源
基本 I/O 资源
Spartan-6 FPGA I/O 资源
Virtex-6 FPGA I/O 资源
实验3：I/O 资源
基本时钟控制资源
3
Spartan-6 FPGA 时钟控制资源
Virtex-6 FPGA 时钟控制资源
实验4：时钟控制资源
存储器控制器
专用硬件
Spartan-6 系列课程概要
1
Spartan-6 FPGA 简介
CLB 架构
HDL 编码技术
实验1：CLB 资源
存储器资源
DSP 资源
实验2：DSP 资源
基本 I/O 资源
Spartan-6 FPGA I/O 资源
2
实验3：I/O 资源
基本时钟控制资源
Spartan-6 FPGA 时钟控制资源
实验4：时钟控制资源
存储器控制器
专用硬件
Virtex-6 系列课程概要
1
Virtex-6 FPGA 简介
CLB 架构
HDL 编码技术
实验1：CLB 资源
存储器资源
DSP 资源
实验2：DSP 资源
基本 I/O 资源
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Virtex-6 FPGA I/O 资源
实验3：I/O 资源
基本时钟控制资源
Virtex-6 FPGA 时钟控制资源
实验4：时钟控制资源
存储器控制器
专用硬件
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